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再问关于ddr2的问题
(1)
2008-08-03
flyfish27
|2008-08-03
swping
spartan 3A全局时钟管脚可以这样用吗?
(3)
2008-07-30
hutcoffee
|2008-08-03
hutcoffee
Cyclone里没有可直接调用的SDRAM的IP的?
(15)
2008-08-01
BESSA
|2008-08-03
sinichi
请教一下该选用什么器件
(9)
2008-07-25
ppxia
|2008-08-02
mitang
有关异步复位的verilog实现
(6)
2008-07-31
xiaoyj617
|2008-08-01
BourneJason
很简单的计数器分频的时序分析问题
(3)
2008-07-30
flyfish27
|2008-07-31
flyfish27
modelsim求助
(2)
2008-07-31
sonneson
|2008-07-31
sonneson
谁给推荐个开发板,带视频输出的
(2)
2008-07-31
chenchong
|2008-07-31
chenchong
altera的fpga有不少1.2v的core供电管脚 使用什么dcdc器件呢?
(9)
2008-07-30
feitengyu
|2008-07-31
bingbinICE
CPLD/FPGA开发QQ群:66939414,欢迎加入!
(2)
2008-07-31
xdingdong
|2008-07-31
xdingdong
谁有8x8点阵led的封装尺寸图?
(6)
2008-07-28
feitengyu
|2008-07-30
xdingdong
有没有一款带xilinx fpga和TI C54系列DSP的开发板?
(1)
2008-07-30
zixun
|2008-07-30
quantins
Re: a的conf_done变高了,但是init_done没变高
(0)
2008-07-30
原帖已删除
|2008-07-30
aleilee
FPGA需要外部Reset信号,需要接全局管脚吗
(6)
2008-07-28
anplayboy
|2008-07-30
aleilee
求教关于NiosII的问题
(10)
2008-07-24
hzhit
|2008-07-30
xixilili
问一个关于nc的问题
(0)
2008-07-29
bismark
|2008-07-29
bismark
新遇到的问题
(0)
2008-07-29
lvbin
|2008-07-29
lvbin
寻志同道合者一起参加电设大赛
(0)
2008-07-28
dtg05
|2008-07-28
dtg05
Xilinx信号名中的后缀“_B”是什么意思?
(4)
2008-07-23
katyusza
|2008-07-28
katyusza
VHDL能否实现在一个时钟周期内,产生3个下降沿
(3)
2008-07-28
federalgerma
|2008-07-28
chenchong
请问:用ATERAcycloneII实现10ns内完成一次加法和存储可行吗?
(1)
2008-07-28
valah
|2008-07-28
chenchong
有没有现成的编码器程序?
(1)
2008-07-19
mmforever
|2008-07-28
chenchong
请教一个VHDL状态机问题
(2)
2008-07-28
federalgerma
|2008-07-28
BourneJason
能推荐一款带8bits采样率大于1MSPS的AD的FPGA开发板么?
(1)
2008-07-28
WanaX
|2008-07-28
bingbinICE
两个有源晶振的接法的区别
(3)
2008-07-28
BESSA
|2008-07-28
tjromaprince
有人用过altera megacore里的ddr2控制器么?
(8)
2008-07-26
flyfish27
|2008-07-28
oBigeyes
v5vx50t的核电压1.0V的电流大概有多少?
(1)
2008-07-26
crazystrays
|2008-07-28
InterRonaldo
请推荐Altera的一款芯片吧,谢谢!
(10)
2008-07-18
mmforever
|2008-07-27
bingbinICE
用到一款TUNRER芯片,一个管脚ADJRSSI
(0)
2008-07-26
melson
|2008-07-26
melson
请问一个优化问题
(1)
2008-07-25
chaopig9
|2008-07-25
idleperson
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