能在以太网差分上叠加脉冲信号么？

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主题:能在以太网差分上叠加脉冲信号么？
楼主|meitianhappy|2022-12-07 10:51:52|展开
如题！

网口RJ45通过脉冲变压器输出差分对，有没有啥好办法在不影响网口通信的条件下，在差分上叠加一个5V的TTL逻辑电平。类似于PAL的模拟上叠加了行场同步信号

多谢指教！
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3楼|meitianhappy|2022-12-07 16:33:15|展开
多谢回复！

目的是为了A端口设备有紧急事件需要B端口设备执行一个保护操作，能够尽快执行。
通过报文的方式，还是太慢，链路传输延迟、B端口设备还要解析报文

【在 Oriphia 的大作中提到: 】
: 这样做的意义何在？数据速率不够你上千兆，再不行上万兆。
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4楼|meitianhappy|2022-12-07 16:42:07|展开
多谢回复！

差分线上加共模电压的话，是不是得先用小电容做AC耦合，然后再上拉到指定的共模电平，这个共模电平实质上就是我要传输的脉冲信号吧？

PHY到变压器的链路直接驱动的，需要有一定的电流驱动能力才能驱动变压器初级线圈。如果用AC耦合的话，有没有风险导致驱动能力不够的啊？

【在 redleaves 的大作中提到: 】
: 参考POE，两对差分线加上不同或相同的共模电平。
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8楼|meitianhappy|2022-12-07 17:51:16|展开
哦。你的意思是把逻辑电平V+和V-分别放到TX和RX差分的中间抽头上啊。这个思路很跨越！

不过，正常的以太网接口设计中，变压器的中那两个抽头是75欧姆电阻串一个高压电容到机壳地的。如果把逻辑电平V+和V-直接放到上面的话，直觉上就对原本的变压器抽头部分设计有影响了吧？具体啥影响我也不明确，至少是如果设备打静电的话，就会通过逻辑电平的接入有个个通道进来了吧，会不会把逻辑电平输出的那部分电路给整出问题了

多谢指教！

【在 redleaves 的大作中提到: 】
: https://www.mouser.cn/images/marketingid/2019/microsites/125947517/Twisted_Pair_PoE.png
: PSE、整流器和PD都不要，直接发送接收逻辑电平。
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12楼|meitianhappy|2022-12-10 17:27:34|展开
多谢回复！

我是计划在控制节点用个隔离电源，然后高速光耦隔离后再把TTL发过去。
是一个控制切割时机的设备，如果延时太长的话，会多切掉材料，累计起来甲方就受不了。

高速光耦本身的延时能控制在50ns，由器件本身的特性决定了。TTL信号在20多米长的网线上传输过去的时间估计也得有1us的延时。被切割材料在线上移动的速度大概是25米/秒，延时时间长或者延时的抖动大了，切割出来的材料长度误差不达标。

stirlitz 提出的鉴权，确实是需要考虑的问题。不过既要考虑延时还要鉴权，我没啥好想法。如果通过以太网内报文的形式，鉴权问题可以完美解决，毕竟报文中可以做鉴权的工作。

多谢指教！

【在 stirlitz 的大作中提到: 】
: 估计他会加隔离器，并不是 TTL 直接长线传过去。
: 应该是个专用定制设备，接口可以自己随便定义。
: 但是，不经任何鉴权。直接发个 TTL 就能紧急操作设备，有点匪夷所思。
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13楼|meitianhappy|2022-12-10 17:29:51|展开
谢谢回复！

您说的网口压差指的是变压器差分线上的共模电压差么？

【在 icfpga 的大作中提到: 】
: 你先把两个设备分别用三相电的两相供电，感受下网口的压差再想想是否真要这么做
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