建议看一下verilog的schedule region就明白了
  
【 在 Schrooman (林如风) 的大作中提到: 】
:  没看懂呢，
:  data_in和data_out在代码里面用的都是<=，只是激励里面给data_in赋值的方式不一样。
:  激励里给data_in用了阻塞和非阻塞，怎么会影响到data_out了？
:  【 在 WebGL 的大作中提到: 】
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