- 主题:纯技术干货讨论贴：高集成度混合信号芯片设计流程
在美帝巨头公司，用的是analog + digital co-simulation流程，可以搞定90%以上的问题。
在海屌丝，分别将数字部分(MPW1)和模拟部分(MPW2)进行MPW验证之后，再将数字、模拟在一起fullmask。
现在的问题是，如果先将模拟部分（MPW2）验证了；数字部分使用FPGA验证，省掉数字MPW1；然后再做fullmask，会有什么风险？
我能想到的是：
1. 数字后端，毕竟FPGA 没法验证后端；
2. 混合信号验证。美帝巨头使用EDA工具进行混合信号验证；海屌丝是将两个MPW1/MPW2的芯片做在板子上验证；如果模拟MPW芯片 + 基于FPGA的数字设计，会不会少了真实数字芯片与模拟芯片进行混合验证的流程？
版上高手云集，望不吝指点一二哈
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FROM 210.22.132.*
这种层次的不需要分别MPW了。工具跑跑就好
【 在 PrimeTime 的大作中提到: 】
: 海思里面adda这种怎么验证？算到模拟mpw2里面还是说也要分成两部分，分别mpw验证？
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FROM 210.22.132.*
相当复杂，不是模块级，是系统级。
【 在 ericking0 的大作中提到: 】
: 感觉还是case by case的说；
: 用过analog + digital 做cosim的流程；
: 用过analog出全behaviour model，让数字验的；
: ...................
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FROM 210.22.132.*
你这个说法有道理，确实是，美国巨头的专家多，推cosim 也是在迭代出几代产品后才开始的；
该踩的坑都已经踩过了，积累的经验和专家非常丰富。即便上cosim没有验出来的问题也有底。
海屌丝可能没这样多经验，所以干脆数字模拟分别MPW，降低风险。
【 在 crazyjaboy 的大作中提到: 】
: 系统级到什么程度？数字部分处理器规模个数？工艺节点？以鄙人观察，国际混合信号巨头之一，在cosim上也很纠结。模拟设计一般不愿意屈尊做很多cosim。数字背景缺乏对模拟的深刻理解。很多时候，花了不少时间，真能在cosim发现的问题，也有限。最后也是怨声载道。当然，完全不做也不合适。本质上这是个复杂的系统问题，我指cosim本身。仿真上，模拟这边，层次化建模: 晶体管级，component，理想器件，verilog-a, real-number, systemverilog等等; 数字这边，gate-level, rtl, system-c。两边合在一起，c, matlab等等。如何交叉级联，某一种组合方式，要验证解决的问题是什么？层次不同，仿真速度精度差距巨大。实现层面上，模拟要不要mpw, 数字是不是fpga, 上不上帕拉丁，等等还是那个问题，看我们要解决关注什么问题。这一点，我觉得国际巨头也不见得真的做得都好。当然，国际巨头厉害的是，积累多，专家多，流程相对扎实。积累多，让你做新产品出问题可能性降低; 专家多是出了问题，真有大牛出来解决; 流程相对扎实这一点，基本保证里，不出弱智问题，虽然有时候挺费时间的。单看一点，比如cosim，未必多好。但是合在一起，厉害地方就显出来了。
: 个人粗浅理解，欢迎讨论，勿拍。
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FROM 210.22.132.*
做板子调试。
【 在 PrimeTime 的大作中提到: 】
: 分别mpw怎么解决模拟和数字之间的接口问题啊？这个跟实际soc里面的接口肯定不一样
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FROM 210.22.132.*
不用了，直接怼。这也是MPW的目的。
【 在 PrimeTime 的大作中提到: 】
: 那肯定也得像fpga验证一样降速吧？
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FROM 101.40.73.*
系统很大，模拟相对来说更加重要。
必须第一版先MPW证明模拟的是好的，才有后面的事情。
【 在 ericking0 的大作中提到: 】
: 如果系统级的话，大概率对模拟精度要求已经很低了，
: 直接把模拟弄成ams或者sv的model来弄吧；
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FROM 101.40.73.*
模拟能不能成，是芯片成功与否的关键。
【 在 PrimeTime 的大作中提到: 】
: 资源足够肯定数字模拟一起验证啊
: 想不出来为啥单独mpw模拟来验证，除非说数字赶不上模拟的进度
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FROM 101.40.73.*
你可以告诉某美帝巨头，你们是错的。
【 在 fdylong 的大作中提到: 】
: 模拟加数字混合仿真?这是条错误的路径
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FROM 117.186.6.*
目前看纯数字的用FPGA验证过了就好，不单独MPW
【 在 combuster 的大作中提到: 】
: 我们做SoC，ADC，RF要单独流片验证，模拟ip的va模型一定要做好。
: 纯数字的单独再流一次感觉没必要了，cosim就行了。
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FROM 210.22.132.*