这是用simulink搭建的模型自动吐出来的rtl，原始设计是图形化搭建的模块，无法从rtl推回去。看代码很难理解其设计原理，但是看图就一目了然
【 在 ttaudi 的大作中提到: 】
: 最近看到有人的源码里信号名全都是杂乱无章，看不出意义，请问这种是怎么实现的呢？是否可以恢复？
:
: 扰乱信号的源码：
: wire \[7:0\] t6\_out1\_8;
: reg \[7:0\] t1\_out1\_9;
: wire signed \[8:0\] t2_
: ..................
发自「今日水木 on CLT-AL00」
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