职责：
主要负责基于FPGA芯片，制定相应的验证方案，构建模块级或系统级的验证平台，并进行测试用例的设计和编写，完成RTL时序仿真、timing及逻辑有效性检查等。
要求：（具备以下任意三条即可）
1、    通信、微电子、计算机相关专业，正规院校本科及以上学历，至少一年以上的RTL开发或验证经验；  
2、    有扎实的Verilog程序设计、调试基础，熟悉常用RTL仿真工具Modelsim、Questasim、VCS等；
3、    熟悉FPGA验证相关知识，熟练掌握FPGA验证流程；
4、    熟悉Altera提供的相关IP核。
实习时间要求：
征得导师同意，实习时间不少于3个月，每周不少于4天，特别优秀者可长期聘用。
薪资：
博士研究生： 500元/天， 硕士研究生：400元/天， 本科生：300元/天。
实习地点：
中科驭数（北京）科技有限公司，北京市海淀区农大南路1号，硅谷亮城4号楼701室
联系方式：
talent@yusur.tech
公司简介：
中科驭数（北京）科技有限公司（简称驭数科技）是全球首家面向金融科技领域提供专用解决方案公司，宗旨是打造金融科技领域专用核心处理器芯片，提升该领域的运算效率，为金融科技渗透到金融相关行业“提质、增效”扫清“算力”层面的障碍，支撑数据驱动的金融创新。
驭数科技的核心团队来自于中国科学院计算技术研究所、计算机体系结构国家重点实验室。该实验室是我国在计算机体系结构领域唯一的国家重点实验室。驭数团队在专用计算架构研究领域十年深耕，为专用架构的研发打下的深厚的基础，也赋予了驭数科技国际领先的“全栈式”垂直行业专用架构研发能力。
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