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Re: 时钟上升沿来之后的保持时间是不是与时钟有关系？与时钟信(0)
2007-12-29 原帖已删除|2007-12-29 sandyhan
Re: QuestaSim与modelsim有何异同?(0)
2007-12-24 原帖已删除|2007-12-24 frankrick
【推荐】Synplify9.0.1的Crack(0)
2007-12-24 endpoint|2007-12-24 endpoint
Re: 请教：Xilinx的库文件在哪里(0)
2007-12-21 原帖已删除|2007-12-21 Jarod
Re: 求问，如何做出较好的7分频？(0)
2007-12-18 原帖已删除|2007-12-18 shihe808
[合集] 关于signaltap的高级触发功能(0)
2007-12-14 dancingblood|2007-12-14 dancingblood
Re: modelsim对路径名支持真弱(0)
2007-12-14 原帖已删除|2007-12-14 Jarod
[公告] 免去 cind 的 FPGATech 版版主职务 (转载)(0)
2007-12-11 freshdreams|2007-12-11 freshdreams
Re: 板卡验证的问题(0)
2007-11-27 原帖已删除|2007-11-27 BourneJason
静态时序分析基础及应用(0)
2007-11-23 mabenli|2007-11-23 mabenli
转一篇关于ADC采样时钟jitter的文章(0)
2007-11-13 mimosaxixi|2007-11-13 mimosaxixi
Re: StratixII下DDR2的DQS phase shift问题(0)
2007-11-13 原帖已删除|2007-11-13 herroyuy
Re: 请大家帮忙找一本书(0)
2007-11-12 原帖已删除|2007-11-12 dataminer
Re: 10个19位数中找最大值的大小和位置，请指点(0)
2007-11-11 原帖已删除|2007-11-11 GreatWind
Re: 关于流水线的疑问(0)
2007-11-10 原帖已删除|2007-11-10 dataminer
Re: 请教：想把语音数据存入ROM，请问怎么办？(0)
2007-11-07 原帖已删除|2007-11-07 fuchuantian
Re: 30万门的设计，能够塞进XC2VP7里面吗？(0)
2007-11-05 原帖已删除|2007-11-05 redsun
Re: 请大侠帮忙，附件的VHDL如何更改能节约LES?(0)
2007-11-02 原帖已删除|2007-11-02 redsun
Re: 请问什么时候用parameter和'define?(1)
2007-11-01 原帖已删除|2007-11-01 BourneJason
Re: 讨论：数字排序的硬件实现方法(0)
2007-10-28 原帖已删除|2007-10-28 report
Re: 布局布线后的时序报告中有大量error(1)
2007-10-28 原帖已删除|2007-10-28 redsun
Re: 做数据采集时，两片FPGA如何同步 (转载)(0)
2007-10-23 原帖已删除|2007-10-23 geniisun
Re: 请问总线时钟和模块时钟不同的时候一般怎么处理(0)
2007-10-18 原帖已删除|2007-10-18 hhran
Re: 诚聘软件加密狗高手!(0)
2007-10-18 原帖已删除|2007-10-18 lingcore
Re: DDR的VTT和VREF是怎么回事？(0)
2007-10-14 原帖已删除|2007-10-14 bjzhangwn
Re: 怎么快速实现512比特2进制数两两相异或(0)
2007-10-10 原帖已删除|2007-10-10 BLC
Re: 求助：fpga与计算机通讯(0)
2007-10-07 原帖已删除|2007-10-07 shooby
Re: SERDES收到的数据不稳定，大家帮我分析一下原因(0)
2007-10-06 原帖已删除|2007-10-06 dataminer
Re: 请教：什么叫归约运算符？(0)
2007-09-20 原帖已删除|2007-09-20 pcong
Re: 请教如何给一个很长的数组赋初值？(0)
2007-09-20 原帖已删除|2007-09-20 redsun