Chisel可以流片？

【 在 Xaoyao 的大作中提到: 】
: 今日，“香山”开源高性能RISC-V处理器问世。据行业人士介绍，这是计算所牵头，多家企业联合开发的开源处理器核，源代码和所有设计文档都开源。
: 从PPT的内容上看，“香山”基于Chisel语言开发，支持多核，采用乱序执行、11级流水、6发射。采用28nm台积电工艺预计达到1.3Ghz主频，采用中芯国际14nm工艺预计达到2Ghz主频。性能评估为7/Ghz(SEPC2006)，换言之，第一版的雁栖湖架构对标的是ARM A72/A73。
: 从PPT上看，“香山”第二代南湖架构的目标是10/G，在采用中芯国际14nm工艺的情况下主频达到2Ghz。从参数上看，南湖架构对标的是A76，2G主频下SPEC06达到20分。如果能够实现这一设计目标，裸CPU性能在RISC-V处理器中是首屈一指的。
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Chisel有工具可以转换成Verilog, 然后后面的流程就都一样了。Berkeley BOOM 开源项目就是用Chisel写的，已经流片10来次了，主频上到1GHz没问题。SiFive有不少的Risc-V IP，应该都是基于Chisel开发的。国内有不少研发Risc-V IP的公司，估计也是基于Chisel开发的，流片那是一点问题都没有

【 在 volsky 的大作中提到: 】
: Chisel可以流片？
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其实感觉还好，毕竟是开源项目，不是商业项目，而且ppt里面提到还经过了FPGA验证。从经验上来说，11级pipeline在28nm做到1.3GHz应该问题不大。哪怕做到1GHz,性能上也应该超过了其它Risc-V开源的核

【 在 rtossystem 的大作中提到: 】
: 没流片就这么高调感觉不太好啊
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越来越好了
【 在 Xaoyao 的大作中提到: 】
: 今日，“香山”开源高性能RISC-V处理器问世。据行业人士介绍，这是计算所牵头，多家企业联合开发的开源处理器核，源代码和所有设计文档都开源。
: 从PPT的内容上看，“香山”基于Chisel语言开发，支持多核，采用乱序执行、11级流水、6发射。采用28nm台积电工艺预计达到1.3Ghz主频，采用中芯国际14nm工艺预计达到2Ghz主频。性能评估为7/Ghz(SEPC2006)，换言之，第一版的雁栖湖架构对标的是ARM A72/A73。
: 从PPT上看，“香山”第二代南湖架构的目标是10/G，在采用中芯国际14nm工艺的情况下主频达到2Ghz。从参数上看，南湖架构对标的是A76，2G主频下SPEC06达到20分。如果能够实现这一设计目标，裸CPU性能在RISC-V处理器中是首屈一指的。
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卖riscv内核的公司忒多了， sifive 晶心 一大堆，这个有啥突出的？

【 在 Xaoyao 的大作中提到: 】
: 今日，“香山”开源高性能RISC-V处理器问世。据行业人士介绍，这是计算所牵头，多家企业联合开发的开源处理器核，源代码和所有设计文档都开源。
: 从PPT的内容上看，“香山”基于Chisel语言开发，支持多核，采用乱序执行、11级流水、6发射。采用28nm台积电工艺预计达到1.3Ghz主频，采用中芯国际14nm工艺预计达到2Ghz主频。性能评估为7/Ghz(SEPC2006)，换言之，第一版的雁栖湖架构对标的是ARM A72/A73。
: 从PPT上看，“香山”第二代南湖架构的目标是10/G，在采用中芯国际14nm工艺的情况下主频达到2Ghz。从参数上看，南湖架构对标的是A76，2G主频下SPEC06达到20分。如果能够实现这一设计目标，裸CPU性能在RISC-V处理器中是首屈一指的。
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