嗯，sdc是这样做我明白了，可以的
但设计怎么做
一个时钟怎么实现4ns周期和5ns周期的切换
注意这个切换是以100个周期为单位的
切换的很频繁

我说的muticycle的方案，包括sdc和设计都要相应的做，sdc就是设muticylce，设计就是用1ns的时钟，做两个多周期逻辑

【 在 SouthTiger07 的大作中提到: 】
: 如果设计是指综合，STA和PR的话，那就create两个时钟，一个4ns, 一个5ns，同时送进去，然后设这两个时钟互为async： "set_clock_groups -async -group clk1 -group clk2". 这样DC, PT和布局布线工具ICC/INNOVUS应该都能同时识别它们，这是数字实现的常规做法
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: 或者如果你能分成两个mode的话，就弄一个时钟，两个SDC, 一个SDC里面4ns周期，另一个SDC里面5ns周期，PR和STA的时候用multi-mode模式，PR时把这两个不同mode的SDC都读进去，工具都能认，这也是常规操作
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